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图示时序逻辑电路是一个:附:触发器的逻辑状态表为:
单选题
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图示时序逻辑电路是一个:附:触发器的逻辑状态表为:
自测模式
A
左移寄存器
B
右移寄存器
C
异步三位二进制加法计数器
D
同步六进制计数器
C
点击查看答案
C
解析
图示为三位的异步二进制加法计数器,波形图分析如下。
← 上一题
图a)所示的电路中,复位信号信号A及时钟脉冲信号cp如图b)所示,经分 析可知,在第一个和第二个时钟脉冲的下降沿时刻,输出Q先后等于:附:触发器的逻辑状态表为:
下一题 →
下列等式中不成立的是:
收录时间: 2020-06-06 06:16:16
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